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    GK7MR0R - Esquema (.pdf) Project Name: GK5MP6Y Rev 1.0 Platform : CMFL_H+N18E-G0 GK5MPFO USBBD - Sub boards - Esquema (.pdf) GK7MR0R - Boardview (.brd)
  2. Avell C62 LIV - Tong Fang (Suzhou) GK7MR0R GK5MP6Y GK5MPFO Rev_1.0.zip Visualizar Arquivo GK7MR0R - Esquema (.pdf) Project Name: GK5MP6Y Rev 1.0 Platform : CMFL_H+N18E-G0 GK5MPFO USBBD - Sub boards - Esquema (.pdf) GK7MR0R - Boardview (.brd) Uploader py2eb Enviado 17/04/2025 Categoria Avell  
  3. Tive um problema semelhante e era conexão ruim do cabo flat. Descobri medindo continuidade entre conector na placa mãe e a placa da câmera.
  4. Usou o comando de teclas Fn+F8 que ativa e desativa a câmera? Também testar com teclado externo pois pode haver problema com as teclas do note.
  5. Parece que a placa esta em proteção. Analizou: PDB1 PQB13 PQB1 PQB2 PUB1 (ACDET, ACOK, REGN,..) A placa esta fora do note com todos periféricos desconectados?
  6. Componentes com "VGA5P@" são usados quando a placa tem GPU dedicada NVIDIA.
  7. Qual a tensão nos terminais da bateria (na placa), sem a bateria conectada?
  8. A tensão de carga deve ser maior que a nominal, procure o datasheet da bateria para ver a tensão de regime de carga. EX: Uma bateria de 3,7V deve ser carregada com 4,2V. A bateria veicular de 12,5V é carregada com alternador de 14,4V
  9. https://eletronicabr.com/search/?&q=EAX67862715 &type=downloads_file&search_and_or=and
  10. Experimenta um destes circuitos alternativo ao P2808: Só diodos: Se pino 3 estiver com nível lógico alto e vai a nível lógico baixo no starter Com BC327: Se pino 3 estiver com nível lógico baixo e vai a nível lógico alto no starter
  11. O Charger e a Bateria se comunicam via SMBus com o EC. Regrava o EC para descartar problema no firmware.
  12. Testou com a fonte de bancada de 10A? OU Testou o carregador original com uma carga para ver se esta fornecendo os 6.92A devidos?
  13. Tá correto, essa negociação é feita pelos pinos CC1 e CC2 da porta USB-C
  14. Complicado esse note, tem um tal: H1 SECURE MICROCONTROLLER (Pág 34) Esse U16 (ANX3429QN-AA-R) me parece ser um MUX (Multiplexador dos dados USB, USB-C, Display Port) O PD (Power Delivery) parece ser incorporado ao Charger U60 (BD99954MWV-E2)... olha o datasheet Sei que todo circuito integrado de PD precisa de um Firmware (BIOS), seja interno, externo ou junto com o do EC. Antes de mais nada, regrava o BIOS do SI/O.
  15. Faltou testar com outra bateria confiável, se a bateria consome muita corrente de carga, o Charger desativa o carregamento. Além disso, deves verificar os resistores de Shunt PRB3 e PRB19 e os resistores PRB8, PRB9, PRB24 e PRB26, alterações nesses resistores faz o Charger interpretar erroneamente o consumo e/ou a carga e entrando em proteção. Alguns modelos de Acer Nitro usam carregador de 7 Amperes; esse usa de quantos Amperes, o que diz a etiqueta do note?
  16. Deveria ter 3V PM_SLP_S4# e PM_SLP_S5# estão com 3V? Página 50 tem as fontes e os sinais de habilitação (EN) assim como os PGOOD que elas geram para o PCH liberar os demais estágios.
  17. Pode começar pelo "Power sequence block" da página 47 do esquema. Verifica também: Pino 108 (ACIN#) Pino 109 (LID_SW#) Pino 128 (AC_PRESENT)
  18. Esse sinal deveria estar em nível alto, falta algum sinal no SI/O para que ele libere esse sinal ou ele tem algum problema. Tenha em mente que SUSP é abreviação de "Suspenso" (o sinal esta suspenso) e se esta suspenso, o sinal 3VSON e 5VSON não ativarão as tensões suspensas (Standby) 3VS e 5VS. Você esta certo, SUSP# estará ativado em nível baixo, mas para ativar 3VSON e 5VSON o SUSP# deve ser desativado (sair da suspensão)... ir a nível alto. Perceba que os sinais 3VSON e 5VSON não tem "#", portanto serão ativados em nível alto e liberam 3VS e 5VS. Abaixo uma imagem da página 46 onde SUSP# deve ir a nível alto e SUSP deve ir a nível baixo para o note ligar, tanto SUSP quanto SUSP# devem ser desativados (sair da suspensão).
  19. É um DrMOS: MP86941 GQVT-Z TQFN 3X5 (28V/30A INTELLI-PHASETM SOLUTION) Fonte: https://media.monolithicpower.com/mps_cms_document/m/p/mps_solutions_for_powering_intel_and_amd_socs_22.04.2020.pdf

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